宁波开放大学数字电子电路作业答案

数字电子电路

学校: 宁波开放大学

平台: 国家开放大学

题目如下：

1. 数字系统除了输入电路、输出电路、电源和功能单元电路外，一定还包括（ ）。

A. 时基电路和控制电路

B. 放大电路和缓冲电路

C. 信号发生和变换电路

答案: 时基电路和控制电路

2. 在数字系统中，目前应用的主流集成芯片是（ ）。

A. 全加器、计数器等功能单元集成电路

B. CPLD、FPGA等可编程逻辑器件

C. 各种智能系统芯片

答案: CPLD、FPGA等可编程逻辑器件

3. 模拟信号是来自大自然的变化不连续的信号。（ ）

答案: 错误

4. 数字信号的波形是脉冲波，只有高电平和低电平。（ ）

答案: 正确

5. 相对模拟系统，数字系统具有稳定性好，可靠性高，抗干扰能力强的特点。（ ）

答案: 正确

6. 中央处理器（CPU）由控制器、运算器和只读存储器三部分组成。（ ）

答案: 错误

7. 小数的转换采用（ ）的方法，直至余数为0，或满足精度为止。

A. 乘2取整，高位在上

B. 除2取整，高位在下

C. 除2取余，高位在下

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8. 奇偶校验码具有（ ）功能。

A. 检错

B. 纠错

C. 检错和纠错

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9. 十进制数转二进制数时，整数部分的转换采用除2取余，高位在下的方法，将十进制数不断除以2，直至商为0。（ ）

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10. 反码的符号位用0表示正数，1表示负数，数值的各位为原码的各位取反。（ ）

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11. 由原码求补码时，数值的各位取反加一。（ ）

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12. 8421码是一种二—十进制码，又称BCD码。（ ）

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13. 图1-1所示符号是（ ）符号。 图1-1 题1-3-5图

A. 与逻辑

B. 或逻辑

C. 非逻辑

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14. 只要决定某一事件的条件中有一个具备，这一事件就不会发生。这个逻辑运算关系是（ ）。

A. 与非

B. 或非

C. 与或非

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15. 图1-2所示开关电路的逻辑关系是（ ）。 图1-2 题1-3-7图

A. 与非

B. 或非

C. 与或非

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16. 输入不同时，输出一定为0；输入相同时，输出可能为0。这个逻辑运算关系是（ ）。 图1-2 题1-3-7图

A. 与非

B. 或非

C. 同或

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17. 表达式不是与或非逻辑运算关系唯一的形式。（ ）

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18. 异或逻辑关系是当输入有1时输出为0，输入有0时输出为1。（ ）

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19. 任何一个含有某一变量的等式中，所有出现该变量的位置都可以用同一个逻辑函数代替，而等式仍然成立。（ ）

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20. 任何一个逻辑表达式，如果将式中所有“·”换成“＋”，“＋”换成“·”，“0”换成“1”，“1”换成“0”，变量保持不变，所得到的表达式就是原函数的反函数。（ ）

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21. 逻辑图表示了逻辑与器件的对应关系，（ ）。

A. 能用它进行逻辑运算，但不便于形成实际电路

B. 便于形成实际电路，但不能用它进行逻辑运算

C. 便于形成实际电路，也能用它进行逻辑运算

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22. 在运用代数化简法进行逻辑函数化简时，可利用（ ）消去AB。

A.

B.

C.

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23. 用卡诺图化简法化简逻辑函数时，（ ）的最小项一定不能合并。

A. 逻辑上相邻

B. 逻辑上不相邻

C. 图形上不相邻

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24. 逻辑表达式的优点是形式简单、书写方便，便于运算和演变。（ ）

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25. 一个确定的逻辑函数关系对应的真值表是唯一的。（ ）

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26. 在数字电路的分析中，一般是根据功能先列出真值表，再转换成逻辑表达式及逻辑图。（ ）

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27. 任意一组变量取值中，只有一个最小项的值为0，其他最小项的值均为1。（ ）

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28. 运用卡诺图化简逻辑函数时，约束项可以任意取值。（ ）

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29. 开关二极管的开通时间ton（ ）关断时间toff。

A. 略小于

B. 大大小于

C. 明显大于

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30. 当输入电压且时，三极管开关电路中管子处在（ ）状态。

A. 放大

B. 截止

C. 饱和

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31. 二极管的管压降 U D必须小于0V才能进入截止状态。（ ）

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32. 三极管的信号传递存在时间延迟，三极管的饱和程度越深，恢复时间越长。（ ）

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33. BJT三极管是电压控制型器件，而MOS管是电流控制型器件。（ ）

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34. 从器件的输出特性曲线图也能看到，增强型NMOS管的开启电压UTN不为0。（ ）

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35. 输入高电平、输出低电平时，反相器负载电流为（ ）。

A. 灌电流

B. 拉电流

C. 零

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36. CMOS传输门之所以可以双向输入，是因为（ ）。

A. 源极与漏极可以互换

B. 源极与栅极可以互换

C. MOS管的压控特性

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37. TTL与非门的输入级由一个多发射极三极管构成，使输入端实现“与非”的功能。（ ）

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38. OC门具有可实现“线与”、连接负载灵活的特点，但负载需要单独设置电源。（ ）

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39. 与高、低电平输出状态一样，TTL三态门的高组态也是由逻辑信号输入端控制的。（ ）

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40. CMOS电路的抗电离幅射能力强，但抗静电能力很差。（ ）

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41. 与CMOS电路相比，TTL电路具有（ ）特点。

A. 延迟时间长、工作频率低

B. 延迟时间短、工作频率高

C. 抗干扰能力强

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42. 与TTL同类门相比，CMOS电路的扇出系数（ ）。

A. 大一些

B. 大很多

C. 差不多大

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43. TTL产品中，目前具有品种齐全、价格低廉特点的主流产品系列是（ ）。 图1-2 题1-3-7图

A. 54/74S

B. 54/74LS

C. 54/74AS

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44. 与74系列TTL引脚兼容、电平兼容的CMOS产品系列是（ ）。 图1-2 题1-3-7图

A. 4000系列

B. 74HC系列

C. 74HCT系列

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45. 数字电路设备的军用级标准是能够在-40～85℃下稳定正常工作。（ ）

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46. TTL电路的标准低电平、标准高电平和阈值电压分别为0.4V、2.4V和1.4V。（ ）

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47. TTL输入端空置为高电平，CMOS输入端不能空置。（ ）

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48. 集成电路芯片CC4066CP的型号名称中末位两个字母CP，分别代表该芯片是CMOS电路和双列直插封装。（ ）

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49. 组合逻辑电路的输出状态与当前的输入信号和电路原来的状态有关。

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50. 组合逻辑电路的输入输出逻辑关系确定后，电路结构也就确定了。

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51. 列写逻辑表达式并化简，是组合逻辑电路的分析与设计过程中共同的关键步骤。

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52. 在实际电路设计中，除逻辑正确外，还要兼顾实现电路功能的经济性、可靠性、方便性和可维护性。

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53. 组合逻辑电路在结构上。

A. 必须包含具有存储功能的元件或电路

B. 可以包含具有存储功能的元件或电路

C. 不能包含具有存储功能的元件或电路

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54. 下列三个逻辑电路框图中，（ ）是译码器。 图a 图b 图c 图3-2 题3-2-7图

A. 图a

B. 图b

C. 图c

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55. 图3-2-14 多位数值比较器（ ） 图3-2-14 多位数值比较器

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56. 编码器只有一路输入信号有效，输出信号为代表该路信号的编码，译码器的输出代表了输入端的编码信息。

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57. 在优先编码器功能表这，输入值为“×”表示该输入端无论何值对编码结果均无影响。

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58. 数据选择器的电路特点是一路输入、多路输出，数据分配器则是多路输入、一路输出。

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59. 多位数值比较器在比较两个多位数的大小时，遵循先低位比较后高位的比较原则，只有在低位相等时，才需要比较高位。

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60. 编码器输入使能端S：的含义是（ ）。

A. S=1时电路处于工作状态；S=0时电路处于禁止状态

B. S=1时电路处于禁止状态；S=0时电路处于工作状态

C. S与电路状态无关

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61. 下列三个逻辑电路框图中，（ ）是译码器。 图a 图b 图c 图3-2 题3-2-7图

A. 图a

B. 图b

C. 图c

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62. CMOS结构的组合逻辑越来越多被采用，是因为CMOS电路耗电量低。

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63. 在组合电路中，信号经因传输途径不同造成的竞争，电路输出一定会发生瞬间错误现象。

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64. 用输出端接电容的方法消除冒险，仅适合对信号波形要求不高或工作频率较低的场合。

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65. 若系统中既有数字电路也有模拟电路，印刷电路板应分别设置接地线再合并接地。

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66. 下列选项（　），不是组合逻辑电路消除竞争与冒险的方法。

A. 增加冗余项

B. 增加选通信号

C. 逻辑化简

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67. 数字集成电路应避免使用锰锌电池供电，其原因是（　）

A. 电压不稳

B. 容易发热

C. 常有腐蚀性液体渗出

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68. 约束条件RS=0的含义是（ ）

A. 输入信号不能同时为1

B. 输入信号可以同时为0

C. 输出状态不能同时为0

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69. 下图所示触发器是（ ）。 图4-1 题4-1-8图

A. 钟控型RS触发器

B. 主从型JK触发器

C. 维持阻塞型D触发器

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70. 时序逻辑电路当前的输出状态不仅取决于即时的输入信号，还与电路原来的状态有关。（ ）

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71. 在CP信号作用下，触发器将从一种状态翻转到另一种状态，并保持状态不变。（ ）

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72. 钟控RS触发器增加同步时钟脉冲，能够有效避免一个时钟周期输入变化多次造成的系统逻辑错误。（ ）

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73. JK触发器的两个输出端为互补关系，所以没有约束条件。（ ）

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74. 数字系统若因主从型触发器的抗干扰能力达不到工作要求，可改用边沿型触发器。（ ）

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75. 维持阻塞型D触发器属于主从型触发器。（ ）

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76. 下图所示计数器是（ ） 图4-2 题4-1-8图

A. 二进制异步加法计数器

B. 二进制异步减法计数器

C. 二进制同步减法计数器

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77. 从下图所示计数器的状态转换图看，该计数器 图4-3 题4-2-8图

A. 能自启动的十进制加法计数器

B. 不能自启动的十进制加法计数器

C. 不确定能否自启动

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78. 锁存器的使能控制LE为低电平时，输出状态为高组态。（ ）

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79. 移位寄存器可以串联输入、串行输出，也可以串行输入、并联输出。（ ）

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80. 二进制异步计数器相对同步计算机电路，电路结构复杂简单但工作速度较快。（ ）

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81. 二进制异步计数器可以作为分频器使用。（ ）

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82. 分析同步时序电路时，首先应该（ ）

A. 写出各触发器输入端的逻辑表达式

B. 写出各触发器的状态方程

C. 画出时序波形图

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83. 设计时序逻辑电路时，首先应由给定的逻辑功能要求（ ）。

A. 写出原始状态图和状态表

B. 画出逻辑电路图

C. 画出全状态图

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84. 下图所示电路能够实现（ ）计数。 图4-4 题4-4-5图

A. M=8

B. M=9

C. M=10

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85. 图所示电路能够实现（ ）计数。 图4-5 题4-4-6图

A. 能够实现8421BCD码

B. 能够实现5421BCD码

C. 电路连线不完整，不能

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86. 下图所示电路能够实现（ ）计数。 图4-6 题4-4-7图

A. 能够实现8421BCD码

B. 能够实现5421BCD码

C. 电路连线不完整，不能

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87. 四位双向移位寄存器74LS194的输入端 同时为0、1、Ф时，输出 ，说明该电路实现了（ ）功能。

A. 保持

B. 左移

C. 右移

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88. 同步计数器74LS163采用同步置0方式，只有在CP脉冲上升沿才能完成置0。（ ）

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89. 使用一片同步计数器74161/74163，可以实现M=24计数。（ ）

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90. 异步计数器74LS290具有同步置0和置9功能。（ ）

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91. 四位单向移位寄存器74LS195和四位双向移位寄存器74LS194都具有异步置0和并行送数。（ ）

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92. 脉冲上升时间就是（　）所需要的时间。

A. 脉冲前沿由0上升到0.9Um

B. 脉冲前沿由0.1Um上升到Um

C. 脉冲前沿由0.1Um上升到0.9Um

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93. 脉冲波是一种间断的、持续时间极短的、突然发生的电信号。（ ）

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94. 脉冲前沿与脉冲后沿间的时间间隔就是脉冲波的重复周期T。（ ）

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95. 占空比 q 等于脉冲宽度tW与重复周期 T 的比值。（ ）

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96. 当 τ = RC 足够小时，在输入脉冲的上升沿，微分电路的输出为（ ）。

A. 正向窄脉冲

B. 负向窄脉冲

C. 随时间呈反比

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97. 单稳态触发器的暂稳态时间 tW 的大小与 RC 常数的关系是（ ）.

A. RC 越大，tW 越长

B. RC 越大，tW 越短

C. RC 越小，tW 越长

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98. 图5-1所示特性施密特电路的为（ ）. 图5-1 题5-2-7图

A. 同向传输特性

B. 反向传输特性

C. 双向传输特性

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99. RC积分电路时间常数 τ 足够小时，输出电压随时间呈正比关系。（ ）

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100. 单稳态触发器的触发脉冲较窄，触发器进入暂稳态的时间 tW 较长。（ ）

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101. 单稳态触发器若采用CMOS门电路构成，为保证稳态时门2输入低电平，电阻 R 必须小于某一数值。（ ）

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102. 施密特触发器属于“电平触发”型电路，不依赖于边沿陡峭的脉冲。（ ）

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103. 石英晶体振荡器的频率稳定度很高，可达到（ ）

A. 10-3～10-5

B. 10-5～10-9

C. 10-9～10-12

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104. 下列三个逻辑电路框图中，（ ）是译码器。 图a 图b 图5-2 题5-3-4图

A. 图（a）是CMOS振荡器，（b）是改进环形振荡器

B. 图（a）是改进环形振荡器，（b）是施密特触发器构成的振荡器

C. 图（a）是施密特触发器构成的振荡器，（b）是CMOS振荡器

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105. 多谐振荡器电路是无稳态电路，若R1=R2，C1=C2，则T= 2tW =1.4RC。（ ）

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106. 环形振荡器不仅电路简单，频率也比较稳定。（ ）

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107. 题图所示555定时器电路中，（ ）是单稳态触发器。 图a 图b 图c 图4-4 题4-4-5图

A. （a）

B. （b）

C. （c）

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108. 555定时器电路中 VCO 到地间连接一个大电容，是起（ ）作用的。

A. 稳定电源电压

B. 耦合输入信号

C. 滤除噪声

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109. 目前流行的555定时器产品中，7555和7556是BJT的，555和556是CMOS的。（ ）

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110. CMOS的555定时器电源范围更宽，但输出级的带负载能力较低。（ ）

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111. 对于取样保持电路，只要充电时间常数（ ）取样信号S（t）的持续时间tw，输出信号uO就能跟踪输入信号uI的变化。

A. 远小于

B. 远大于

C. 接近

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112. 量化单位mmin不可能为无穷小，由此带来的量化误差不能被消除。（ ）

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113. A/D转换器的二进制位数越多，能分辨的最小模拟量越小，A/D转换器的分辨率也就越高。（ ）

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114. 转换速率等于每秒转换的次数，所以它与转换时间是倒数关系。（ ）

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115. 对于一个n位D/A转换器，可输出模拟量的最大值等于2nVREF。（ ）

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116. 若模拟参考量为R，则输出数字量D和输入模拟量A之间的关系为（ ）。

A. D≈A·R

B. D≈A/R

C. D≈R/A

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117. 双积分型A/D转换器的特点是（ ）

A. 精度较高，速度较快

B. 精度较高，速度较慢

C. 精度较低，速度较快

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118. 电阻型D/A转换器中，解码网络所用的阻值范围较大，即便分辨率较高时集成电阻也能较好地保证转换精度。（ ）

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119. MAX5013是一个高速D/A转换器，它的最高工作速率能达到100MHZ。（ ）

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120. 并行比较型A/D转换器是所有ADC中转换速率最高的，可用于视频转换。（ ）

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121. 逐次比较型A/D转换器的特点是电路比较简单，但速度较慢。（ ）

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122. 动态存储器DRAM具有（ ）的特点。

A. 速度慢，集成度高

B. 速度快，电路复杂

C. 速度快，电路简单

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123. 只读存储器ROM正常工作状态下只能从中读取数据，不能随时修改。（ ）

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124. 静态存储器SRAM集成度高；动态存储器DRAM存取速度快。（ ）

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125. Flash Memory是一种能够快速擦写的E2PROM，主要用于优盘等存储设备中。（ ）

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126. 存储容量是指存储器能够存储（ ）。

A. 一位二进制单元的总和

B. 一个字节的二进制数总和

C. 两者均可

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127. 闪存像RAM一样以字节为单位改写数据。（ ）

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128. 存取时间是指存储器完成一次“读”或“写”操作经历的时间。（ ）

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129. 存储器位扩展的方法是，将各芯片地址线、片选CS、读/写控制线并联在一起，数据线分别引出。（ ）

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130. 在PLD的基本结构中，（ ）构成了PLD的主体。

A. 与阵列

B. 或阵列

C. 与阵列和或阵列

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131. 题图所示PLD连接方式是（ ）。 图6-1 题6-3-4图

A. 固定连接

B. 编程连接

C. 不连接

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132. 一个数字系统除了方案设计和输入电路外，其他功能都可用编程软件自动完成。（ ）

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133. LA是与编程、或固定器件。（ ）

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134. CPLD和FPGA都具有输入/输出单元、二维逻辑块阵列和用于连接逻辑块的互连资源。（ ）

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135. FPGA采用EEPROM存储技术，可重复编程，系统掉电后，数据不会丢失。（ ）

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136. FPGA器件含有丰富的触发器资源，易于实现时序逻辑功能；CPLD的与或阵列结构，适宜实现较大规模的组合逻辑功能。（ ）

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137. 相对FPGA而言，CPLD更易于大规模集成，集成度可达千万门以上。（ ）。

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138. 十进制数（127.0625）10换算成二进制数，正确结果是（ ）。

A. （11101.101）2

B. （1111111.0001）2

C. （1011101.0011）2

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139. 将二进制数（101011.101101）2转换成十进制数，正确结果是（ ）。

A. （45.839844）10

B. （44.839125）10

C. （43.703125）10

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140. 将二进制数（100110.100111）2转换成十六进制数，正确结果是（ ）。

A. （26.9C）16

B. （92.97）16

C. （46.47）16

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141. 经证明，等式（ ）正确。

A.

B.

C.

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142. 在下列真值表中，A、B为输入逻辑值，（ ）列的输出结果有误。 A B 0 0 1 0 0 0 1 0 1 0 1 0 0 1 1 1 1 1 0 1

A.

B.

C.

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143. 题图所示电路能够实现（ ）逻辑关系。

A. 与

B. 或

C. 与或非

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144. 对于TTL电路，0.7V的输入电压为（ ）输入。

A. 高电平

B. 低电平

C. 不能确定

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145. 在门电路的电气特性中，将输出电压急剧上升或下降所对应的（ ）称为阈值电压。

A. 输入电压

B. 输出电压

C. 开启电压

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146. 对于TTL电路，当本级门电路输出高电平时，输出端电流（ ）。

A. 向外流出，电路带拉电流 国家开放大学 负载

B. 向内流入，电路带灌电流负载

C. 不确定

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147. OC门“线与”连接并正常工作的前提是（ ）。

A. 电路输出端只需一个外接负载电阻

B. 每个OC门分别接一个负载电阻

C. 电路输出端需要外接电源

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148. CMOS电路多余输入端（ ）。

A. 能悬空

B. 不能悬空

C. 不确定

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149. 题图所示逻辑电路逻辑关系是（ ）。

A.

B.

C.

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150. 将十进制小数转换成其他进制数时，应把小数部分乘以新进制的基数（如二进制的基数为2），把得到的整数部分作为新进制小数部分的最低位。（ ）

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151. 逻辑函数可以用真值表、逻辑表达式和逻辑电路图来表示，也可以用卡诺图表示，但卡诺图与其他形式不能相互转换。（ ）

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152. 波形图用于反映逻辑变量之间随时间变化的规律，能够方便直观地表现输入变量的逻辑关系。（ ）

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153. 门电路的带负载能力用扇出系数表示，它通常由门电路输出低电平时的带负载能力决定。（ ）

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154. 三态门是能够实现“线与”的逻辑门，当它处于高阻态时，输出端与电路连接断开。（ ）

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155. CMOS门电路在输入端和输出端的反相器，起到缓冲隔离和规范逻辑电平的作用。（ ）

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156. CMOS反相器的噪声容限大于TTL门电路的噪声容限，所以抗干扰能力也比TTL电路强。（ ）

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157. CMOS电路多余输入端不能悬空，TTL门电路的多余输入端可以悬空，悬空端相当于逻辑高电平。（ ）

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158. （1）根据题意列出真值表，正确结果为（ ）； A B C F 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 0 1 0 1 0 1 1 0 0 1 1 1 1 (a) A B C F 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 1 1 0 0 0 1 0 1 1 1 1 0 1 1 1 1 1 (b) A B C F 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 0 1 0 1 1 1 1 0 1 1 1 1 1 (c)

A. 真值表（a）

B. 真值表（b）

C. 真值表（c）

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159. （2）按最小项列出正确的逻辑表达式为（ ）；

A.

B.

C.

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160. （3）正确是最简逻辑表达式为（ ）。

A.

B.

C.

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161. （1）该电路为一个门电路连接较多门电路作为负载的结构形式，该电路应该优先选用（ ）；

A. TTL门电路

B. CMOS门电路

C. 两者均可

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162. （2）该电路以静态工作状态为主，若考虑功耗因素应选用（ ）。

A. TTL门电路

B. CMOS门电路

C. 两者均可

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163. 由组合逻辑电路的功能特点可知，任意时刻电路的输出( )。

A. 仅取决于该时刻的输入状态

B. 仅取决于电路过去的输出状态

C. 与该时刻输入状态和电路过去的输出状态均有关

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164. 下列消除竞争冒险的方法中，( )是错的。

A. 在逻辑设计时增加冗余项

B. 接入滤波电容

C. 引入时钟脉冲

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165. 普通二进制编码器的输入变量中，任何时刻( )。

A. 均可多个被编对象有输入，它们共同确定编码结果

B. 均可多个被编对象有输入，但只对优先级别最高的进行编码

C. 仅有一个被编对象有输入，其他均没有输入

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166. 三位同学按“少数服从多数”原则设计表决器逻辑电路，下列电路中（ ）是错误的。

A. 图（a）

B. 图（b）

C. 图（c）

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167. 下列三个逻辑电路框图中，（ ）是译码器。

A. 图a

B. 图b

C. 图c

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168. 16选1数据选择器应该有( )个数据输入端。

A. 4

B. 8

C. 16

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169. 由时序逻辑电路的功能特点可知，任意时刻触发器电路的输出状态( )。

A. 仅取决于电路的输入信号

B. 仅取决于现 渝粤教育 在的输出状态

C. 不仅取决于输入信号，还与输入信号作用前的现态有关

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170. 主从触发器在每个CP脉冲周期，( )。

A. 主触发器和从触发器的输出状态都只能改变一次

B. 主触发器的输出状态可能改变多次，但从触发器只能改变一次

C. 主触发器只能改变一次，但从触发器的输出状态可能改变多次

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171. 由RS触发器的真值表可知，它的状态方程和约束条件是（ ）。 R S 0 0 0 1 1 1 0 0 1 1 不允许

A.

B.

C.

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172. 为了把串行输入的数据转换成并行输出的数据，可以使用( )。

A. 计数器

B. 移位寄存器

C. 数据选择器

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173. 与同步时序电路相比，异步时序电路的主要缺点是( )。

A. 抗干扰能力差

B. 功耗大

C. 速度慢

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174. N个触发器可以构成最大计数长度为( )的计数器。

A. N

B. N2

C. 2N

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175. 组合逻辑电路符合逻辑关系的最简电路形式不会发生竞争冒险现象。( )

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176. 多位数值比较器在比较两个多位数的大小时，遵循先低位比较后高位的比较原则，只有在低位相等时，才需要比较高位。

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177. CMOS结构的组合逻辑越来越多被采用，是因为CMOS电路耗电量低。（ ）

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178. 若系统中既有数字电路也有模拟电路，印刷电路板应分别设置接地线再合并接地。（ ）

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179. 触发器虽然也是由门电路构成，但它与组合逻辑电路不同，具有逻辑状态的记忆功能。( )

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180. 将主从JK触发器的J和K端都接低电平，则在时钟脉冲CP的作用下特性方程应为。（ ）

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181. 当D触发器的现态时，为使每个CP脉冲该触发器翻转一次，D端应接至。（ ）

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182. 由M进制集成计数器构成N进制计数器，当M＜N时一般采用清零法或置位法，当M＞N时则适合采用级联法。（ ）

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183. （2）经分析，该电路具有（ ）功能。

A. 表决

B. 单、双数判断

C. 四舍五入

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184. 分析图2-4所示电路的逻辑功能。在下列选项中选择正确答案填入空内。 （1）该电路使用的触发器是（ ）。

A. 下降沿触发的边沿JK触发器

B. 上升沿触发的边沿JK触发器

C. 主从JK触发器

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185. （2）分析可知，该电路为（ ）。

A. 状态图如图2-5（a）所示，不能自启动五进制同步计数器，

B. 状态图如图2-5（b）所示，能自启动五进制同步计数器，

C. 状态图如图2-5（c）所示，能自启动六进制同步计数器，

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186. （3）在CP脉冲的作用下，该电路时序图为（ ）。

A. 图2-6（a）

B. 图2-6（b）

C. 图2-6（c）

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187. （1）该电路最简与或形式的逻辑表达式是（ ）。

A.

B.

C.

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188. 单稳态触发器与多谐振荡器在状态的区别是（ ）。

A. 前者没有稳态，后者只有一个稳态

B. 前者没有稳态，后者有两个稳态

C. 前者只有一个稳态，后者没有稳态

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189. 广东开放大学 石英晶体多谐振荡器的突出优点是（ ）。

A. 速度快

B. 振荡频率稳定

C. 价格便宜

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190. 为了将正弦信号转换成脉冲信号，信号频率不变，可以采用（ ）。

A. 单稳态触发器

B. 多谐振荡器

C. 施密特触发器

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191. 555定时器的阈值为（ ）。

A.

B.

C.

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192. 在A/D转换器和D/A转换器中，衡量转换精度通常用（ ）。

A. 分辨率

B. 转换误差

C. 分辨率和转换误差

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193. 下列三种A/D转换器中，（ ）的转换速度最快。

A. 双积分型

B. 并行比较型

C. 逐次比较型

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194. 某自动控制系统中，微机与执行部件之间的接口电路应采用（ ）。

A. A/D转换器

B. D/A转换器

C. 施密特触发器

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195. RAM是由存储矩阵、地址 ( )和读/写控制电路三部分组成的。

A. 译码器

B. 编码器

C. 分配器

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196. 只能读出不能改写，信息可永久保存的半导体存储器是（ ）。

A. ROM

B. PROM

C. EPROM

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197. 利用双稳态触发器存储信息的RAM称为（ ）。

A. 闪存

B. SRAM

C. DRAM

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198. 某ROM电路有8根地址线，4根数据线，该ROM电路的容量为( )。

A. 256×4

B. 512×4

C. 1024×4

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199. 下列PLD芯片中，与阵列、或阵列均为可编程的是( )器件。

A. PLA

B. PAL

C. GAL

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200. 图2-6所示阵列逻辑电路的逻辑函数表达式是（ ）。

A.

B.

C.

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201. 单稳态触发器的输出脉冲宽度仅取决于电路本身的充放电时间参数，而与输入触发脉冲无关。( )

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202. 多谐振荡器不需要外加输入信号，只要接通电源就能通过自激产生振荡波形，所以它也是一种正弦波振荡器。( )

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203. 555定时器是一种用途极广泛的集成电路，包括双极型和CMOS型产品的所有型号最后三位数码都是555，外部引脚的排列完全相同。( )

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204. D/A转换器的转换精度与电阻网络的元件参数误差有关，与基准电压的稳定性无关。( )

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205. 若逐次逼近型A/D转换器的输出为n位数字量，进行一次A/D转换至少需要经过n+2个CP周期才能完成。( )

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206. A/D转换器的相对误差≤±LSB/2，表明实际输出的数字量与理论值的误差小于最低位的半个字。( )

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207. RAM是由存储矩阵和地址译码器两部分组成的。( )

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208. SRAM是利用MOS管栅极电容存储电荷效应的半导体存储器。( )

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209. 用4片256×4位RAM芯片，可扩展成512×8位的RAM存储系统。( )

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210. PAL器件中，与阵列和或阵列是电路的核心，不同的芯片输出结构差异很大。( )

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211. 产品研制过程中需要不断修改的中、小规模逻辑电路，不适合选用GAL芯片。( )

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212. FPGA由可编程逻辑快、可编程I/O模块和可编程内连线三部分组成。( )

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